#hdl #hardware #fpga #firrtl #semiconductor

法雅利特-访问生成器

法雅利特的实现细节 — 访问/折叠实现生成器

1 个不稳定版本

0.1.0 2024 年 7 月 26 日

#102模拟

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法雅利特 中使用

LGPL-3.0-or-later

36KB
963 代码行

法雅利特

法雅利特是一个用于设计数字硬件的库 — Rust 编程语言中嵌入的硬件描述语言 (HDL)。法雅利特的语义基于 FIRRTL,由 LLVM CIRCT 解释。

依赖项

~1.7–2.8MB
~55K SLoC